Encolher nanofitas 2D para 35 nm aumenta a corrente do transistor


Um novo estudo mostra que nanofitas semicondutoras 2D em escala agressiva podem fornecer corrente mais alta, comutação mais nítida e menor resistência de contato, desafiando a suposição de que canais ultraestreitos devem sacrificar o desempenho.

Encolher nanofitas 2D para 35 nm aumenta a corrente do transistor

Papel: Dimensionando nanofitas semicondutoras bidimensionais para eletrônica de alto desempenho. Crédito da imagem: imagem gerada por IA / OpenAI

Em um artigo de pesquisa recente publicado na revista Comunicações da Naturezaos pesquisadores demonstram que aumentar a largura do canal dos transistores de nanofita de dichalcogeneto de metallic de transição monocamada para ~ 30-40 nm, dentro da faixa testada, não apenas preserva, mas também melhora o desempenho do dispositivo, alcançando densidades de corrente significativamente mais altas e eletrostática aprimorada para futuros eletrônicos ultraescalados.

Desafios de dimensionamento de nanofitas 2D

O escalonamento contínuo dos transistores de silício tem impulsionado a eletrônica moderna há décadas, mas à medida que as dimensões se aproximam do regime nanométrico, as arquiteturas planares tradicionais enfrentam limites físicos fundamentais. Para sustentar a lei de Moore e melhorar a densidade e o desempenho do dispositivo, arquiteturas de transistores tridimensionais, como gate-all-around (GAA) nanofitas e transistores de efeito de campo complementares (CFETs) surgiram como soluções promissoras.

Criticamente, essas arquiteturas exigem larguras de canal reduzidas a dezenas de nanômetros para otimizar a área ocupada pelo dispositivo e o controle eletrostático. Dichalcogenetos de metais de transição monocamada (DTM), uma classe de bidimensionais atomicamente finos (2D) semicondutores, possuem superfícies naturalmente passivadas e corpos ultrafinos, que são benéficos para o dimensionamento last, tornando-os os principais candidatos para essas aplicações.

No entanto, pesquisas anteriores focaram principalmente em canais TMD relativamente largos (larguras em escala micrométrica), deixando seu comportamento sob escala de largura agressiva amplamente inexplorado.

Fabricação e caracterização de nanofitas

Este estudo investiga o efeito do escalonamento agressivo da largura do canal em transistores de efeito de campo de nanofita TMD monocamada (FETs), focando principalmente no MoS2 como um sistema modelo e estendendo as descobertas para dispositivos WS2 tipo n e WSe2 tipo p. Os autores fabricaram nanofitas com larguras de até aproximadamente 35 nm e comprimentos de canal variando de 55 nm a 75 nm.

A fabricação começou com filmes MoS2 e WS2 de monocamada de feixe molecular cultivados em epitaxia de 2 polegadas e filmes MoS2 e WSe2 de monocamada cultivados por deposição de vapor químico de 2 polegadas, que foram transferidos para substratos locais de portão inferior. As nanofitas foram padronizadas através de um processo de gravação por plasma Cl2/O2 otimizado para produzir características suaves e estreitas sem comprometer a integridade estrutural. A litografia por feixe de elétrons definiu a largura da nanofita e os contatos fonte/dreno, que consistiam em contatos de Ni para permitir a injeção de transportadores, embora a variabilidade relacionada ao contato permanecesse uma consideração importante.

Os dispositivos incorporaram dielétricos HfO2 ultrafinos, cultivados em camada atômica (3 nm em baixa temperatura para MoS2 e 6 nm em temperatura mais alta para WS2 e WSe2) em portas inferiores locais para garantir forte eletrostática e controle de porta. Microscopia eletrônica de varredura (SEM) e microscopia de força atômica (AFM) verificaram as dimensões e uniformidade das nanofitas.

Espectroscopia Raman e fotoluminescência (PT) o mapeamento forneceu análise de cristalinidade e propriedades ópticas relacionadas às bordas. A caracterização elétrica sob condições de vácuo utilizou um analisador de parâmetros semicondutores para medir as características de transferência e saída, permitindo a extração de valores de mérito, como densidade de corrente, oscilação subliminar (SS), tensão limite, resistência de contato e mobilidade efetiva.

Método de comprimento de transferência (TLM) estruturas permitiram a determinação quantitativa da resistência de contato. Projeto auxiliado por computador (TCAD), simulações, complementando resultados experimentais, mapearam o ambiente eletrostático e distribuições de portadores em nanofitas em escala.

Mecanismos de melhoria de desempenho

Este estudo demonstra que o escalonamento agressivo da largura dos transistores de efeito de campo (FETs) de nanofita MoS2 monocamada melhora significativamente o desempenho do dispositivo, em vez de degradá-lo dentro do regime experimentalmente acessível. Dispositivos com larguras de canal dimensionadas de aproximadamente 540 nm até ~35 nm exibem um aumento médio de cerca de 42% na densidade de corrente e uma redução de 16% na oscilação sublimiar.

O dispositivo de nanofita MoS2 de melhor desempenho atinge uma densidade de corrente máxima excepcional próxima de 995 μA μm¹ com uma tensão dreno-fonte de 1 V e uma tensão de overdrive de 2,5 V, superando muitos dispositivos TMD monocamada anteriores com dimensões de canal semelhantes.

Caracterizações estruturais e ópticas, incluindo espectroscopia Raman e mapeamento de fotoluminescência, confirmam a preservação da cristalinidade e da qualidade óptica após a padronização das nanofitas, indicando desordem mínima induzida pela borda.

Supõe-se que isso esteja parcialmente relacionado à incorporação de oxigênio durante a gravação, o que poderia passivar os estados intermediários relacionados à vacância de enxofre. As simulações TCAD revelam ainda campos elétricos intensificados e densidades de portadoras elevadas localizadas nas bordas da fita sob polarização da porta, melhorando o controle do canal eletrostático.

Crucialmente, um dos principais contribuintes para a melhoria do desempenho, particularmente em dispositivos de canal curto e com contato limitado, é a redução substancial na resistência de contato, de ~860 Ω·μm em canais mais largos para aproximadamente 270 Ω·μm em nanofitas estreitas.

Isto surge de uma injeção de contato lateral mais eficiente, possibilitada pela maior contribuição relativa das bordas das nanofitas para a injeção de contato e pela melhoria da penetração do campo de porta próximo aos contatos, confirmada quantitativamente por meio de medições TLM. Embora a mobilidade efetiva da portadora diminua moderadamente (~ 24%), provavelmente devido à dispersão da rugosidade das bordas e aos estados de armadilha residual, as métricas gerais do dispositivo se beneficiam marcadamente do dimensionamento da nanofita.

Estendendo esta plataforma, os autores demonstram FETs de nanofitas complementares de alto desempenho baseados em WSe2 tipo p e WS2 tipo n com dielétricos de porta otimizados. Apesar das nanofitas WSe2 serem mais largas (~ 80 nm) para melhorar o rendimento de fabricação, os WSe2 p-FETs dopados com NO exibem comutação acentuada e alta corrente (~ 357 μA μm¹), ressaltando a versatilidade mais ampla da plataforma de nanofitas para eletrônica de dichalcogeneto de metallic de transição monocamada.

Implicações para a eletrônica do futuro

Esta pesquisa apresenta uma demonstração sistemática de que o dimensionamento agressivo da largura do canal dos transistores de nanofita TMD monocamada para tão estreitos quanto ~ 30-40 nm não apenas preserva, mas melhora as métricas de desempenho do dispositivo relevantes para aplicações nanoeletrônicas.

Alcançar nanofitas abaixo de 10 nm com bordas suaves e passivação eficaz será essential para a futura eletrônica ultraescalada, já que a rugosidade das bordas e a dispersão relacionada à desordem podem se tornar mais significativas nessas dimensões e potencialmente compensar os benefícios observados em ~35 nm. No geral, este trabalho estabelece a largura do canal como um parâmetro crítico de projeto em nanoescala, abrindo novos caminhos para nanofitas semicondutoras bidimensionais para permitir dispositivos eletrônicos de alto desempenho de próxima geração em arquiteturas de transistores tridimensionais.

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